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1. |
Record Nr. |
UNINA9910554493503321 |
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Autore |
Wecker Dieter |
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Titolo |
Prozessorentwurf mit Verilog HDL : Modellierung und Synthese von Prozessormodellen / / Dieter Wecker |
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Pubbl/distr/stampa |
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Berlin ; ; Boston : , : De Gruyter, , [2021] |
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©2021 |
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ISBN |
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Edizione |
[1st ed.] |
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Descrizione fisica |
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1 online resource (X, 326 p.) |
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Collana |
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Classificazione |
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Soggetti |
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COMPUTERS / Systems Architecture / General |
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Lingua di pubblicazione |
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Formato |
Materiale a stampa |
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Livello bibliografico |
Monografia |
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Nota di contenuto |
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Frontmatter -- Vorwort -- Inhalt -- 1 Grundlagen -- 2 Das 12-Bit-Mikroprozessor-System(1) -- 3 Modellierung des 12-Bit-Mikroprozessor-Systems(1) -- 4 Das 12-Bit-Mikroprozessor-System(2) -- 5 Modellierung des Mikroprozessor-Systems(2) -- 6 Das 12-Bit-Mikroprozessor-System(3) -- 7 Das 16-Bit-Mikroprozessor-System(4) -- 8 Modellierung des Mikroprozessor-Systems(4) -- 9 Das 16-Bit Mikroprozessor-System(5) -- 10 Modellierung des 16-Bit-Mikroprozessor-Systems(5) -- A Anhang -- Literatur -- Stichwortverzeichnis |
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Sommario/riassunto |
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The book introduces the design of microprocessors with the help of the hardware description language Verilog HDL. The target group of the book are mainly students of computer science and electrical engineering and developers who want to familiarize themselves with the topic. |
Verschiedene Entwürfe von 12- und 16-Bit-Mikroprozessoren sowie ihre Modellierung und mögliche Realisierung durch die Verwendung von FPGAs (Field Programmable Gate Array) werden in diesem Buch beschrieben. Dazu wird die Hardware-Beschreibungssprache Verilog HDL verwendet. In allen Phasen des Entwurfs wird der Source-Code ausführlich behandelt. Die Verilog-Modelle werden auf Basis der Synthese-Berichte miteinander verglichen und Vor- und Nachteile herausgearbeitet. Die Entwürfe wurden mit einer CAD (Computer Aided |
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